Changes between Initial Version and Version 1 of Ex10 マルチサイクルプロセッサの拡張2017


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Jul 3, 2017 4:54:03 PM (9 years ago)
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nakasato
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  • Ex10 マルチサイクルプロセッサの拡張2017

    v1 v1  
     1トップ:http://galaxy.u-aizu.ac.jp/note/wiki/CAEX2017 
     2 
     3= 概要 =  
     4JR命令および、JAL命令を実行できるようにマルチサイクルプロセッサを拡張する。 
     5 
     6これまで設計したマルチサイクル方式プロセッサは、JAL命令およびJR命令は実装されていません。 
     7この課題では、これらの命令を実行できるようにします。 
     8そのためには、データパスと制御部分を拡張する必要があります。 
     9これまで作成した回路も、レポート提出に必要ですので、動作可能な状態で保存をしておいてください。 
     10 
     11JR命令とJAL命令を実現するために必要なデータパスの変更は  を参照すること。 
     12 
     13このPDF図で"Op"と"Op2"とある命令コードの名前は、Ex09のテンプレートではそれぞれ"OP1"と"OP2"という名称で定義しているので注意してください。 
     14 
     15状態遷移としてstate 13を14を加えます。それぞれの場合について説明します。 
     16 
     17== JR命令 == 
     18JR命令の場合、state 0で命令をフェッチしたのち、state 1の次に13に遷移します。 
     19 
     20JR命令は、命令フィールド![25-21]で指定されたレジスタの内容にジャンプします。 
     21ジャンプを実現するには、適切な値をPCに転送することが必要です。 
     22 
     23ブロック図から、命令フィールド![25-21]で指定されたレジスタの値はレジスタAに格納されていることがわかるので、 
     24この値をPCに転送するために、PCのロード入力に接続されているマルチプレクサの入力を増やし、 
     25その入力とレジスタAの出力を接続しました(データパスの変更を参照)。 
     26 
     27最終的に、state 13ではPCSourceを適切な値に設定することで、レジスタの値はPCに転送します。 
     28 
     29== JAL命令 == 
     30JAL命令は、サブルーチンの実行時などに利用され、通常のJUMP命令(state 9を参照)と同様の動作に加えて、 
     31あとで戻ってくるアドレスの値(PC+4)をレジスタ31に保存します。 
     32PC+4の値は state 0において計算されておりPCに格納されています。 
     33この値をレジスタに格納するために、!MemtoReg(2 bitに拡張)が制御するマルチプレクサを3入力にし、 
     34PCの出力をそのマルチプレクサに接続します(データパスの変更を参照)。 
     35また、格納するレジスタの番号は31に固定なので、RegDstの接続されているマルチプレクサを3入力にし、 
     36レジスタ番号31を選択できるようにします。 
     37 
     38最終的に、state 14ではJUMP命令と同様の動作に加えて、MemtoRegとRegDstを適切な値に設定し、 
     39RegWriteをアサートすることで、PC+4の値をレジスタ31に保存します。 
     40 
     41== 主制御ユニットの変更点 == 
     42 * state 13(JR命令)とstate 14(JAL命令)を追加。いずれも、そのあとはstate 0に戻る。 
     43 * JR命令をR形式命令と区別するため、命令フィールド![5-0]を入力に追加する。これの名称はOp2とする(図参照)。 
     44 * それに伴い、R形式命令の判定部分の論理を変える必要がある。JR命令の場合(Op2 == 0x8)と「それ以外」の通常のR形式命令にわけて考える。 
     45 * !RegDst、MemtoRegのビット幅が変更になる。 
     46 
     47== データパスの変更点 == 
     48 * MemtoRegが制御するマルチプレクサを3入力にする。増えた入力はPCと接続。 
     49 * RegDstが制御するマルチプレクサを3入力にする。増えた入力はジャンプ先のアドレスを保存するレジスタのアドレス31になる。 
     50 * PCsourceが制御するマルチプレクサを4入力にする。増えた入力はレジスタAの出力。 
     51 
     52= 問題1 =  
     53以上の説明をもとに、拡張したデータパスと制御部を設計し、動作確認をしなさい。 
     54動作確認には、Ex3の「課題6:手続きを用いた行列の積アルゴリズム」を使うこと。 
     55 
     56このプログラムでは、スタックポインタ$SPを用いるので、プログラムの最初に 
     57  
     58 ori $sp, $0, 32767 
     59 
     60命令を挿入し、スタックポインタを初期化します。32767はメモリの最大アドレスです。 
     61追加したプログラムを用いて、xspimを 利用してtestfixtureファイルを作成しテストベンチファイルを作成します.それをverilogに与えて,シミュレーションを実行します。 
     62注意:Addu命令はAdd命令に置き換えておきます。 
     63 
     64テストベンチのなかで、$displayコマンドを用いてメモリ領域Cの値を出力させます。 
     65領域Cのアドレスはxspimで確認してください。 
     66 
     67= 問題2 =  
     68同様に、Ex3の「再帰手続き呼び出し」をシミュレーションしてください。 
     69その際に、mul命令はサブルーチン呼び出しに変更すること。 
     70 
     71問題1と同様にアセンブリプログラムにスタックポインタの初期化を追加し、動作確認を行ってください。 
     72$displayコマンドで、メモリ領域FNの値を出力させます。領域FNのアドレスはxspimで確認してください。